一种低温度系数高阶补偿基准电压电路设计

张涛, 邱云飞, 刘劲

湖南大学学报(自然科学版) ›› 2024, Vol. 51 ›› Issue (6) : 178 -186.

PDF (2423KB)
湖南大学学报(自然科学版) ›› 2024, Vol. 51 ›› Issue (6) : 178 -186. DOI: 10.16339/j.cnki.hdxbzkb.2024237
电气与信息工程

一种低温度系数高阶补偿基准电压电路设计

    张涛, 邱云飞, 刘劲
作者信息 +

A Low Temperature Coefficient High Order Compensation Voltage Reference Design

    Tao ZHANG, Yunfei QIU, Jin LIU
Author information +
文章历史 +
PDF (2480K)

摘要

基准电压对模拟系统的性能与精度有着至关重要的影响.一般的曲率补偿仅能消除与温度相关的二阶项,难以满足某些电路对高精度的要求.现有的电路存在温度系数较高的问题,亟须对更高阶进行补偿.本文提出了一种新的高阶曲率补偿方法,通过利用CMOS晶体管亚阈值特性设计,成功实现了一种低温度系数电压基准电路.该方法首先利用两个不同温度系数的电流流过相同的亚阈值区CMOS晶体管,产生两个具有不同温度特性的栅源电压.然后,通过对这两个不同温度特性的栅源电压进行相减,产生对数电压,并与一阶补偿电压进行加权叠加,从而实现高阶补偿.为了提高电源抑制比(PSRR),该电路采用了高增益负反馈回路,避免了传统电压基准电路中放大器的使用,进一步地降低了功耗.本设计基于0.18 μm CMOS工艺,在Cadence软件下完成电路设计、版图设计与仿真验证.仿真结果显示,该电路正常工作电压范围为1.6~3 V,在2 V的工作电压下,基准电压输出295 mV,在-45~125 ℃范围内温度系数为1.26 ppm/℃,PSRR为51.1 dB@1 kHz,最大静态电流为8.9 μA.结果表明,该基准电压电路能够满足高精度集成电路系统的需求.

Abstract

Voltage reference plays a crucial role in influencing the performance and accuracy of analog systems. General curvature compensation techniques focus solely on eliminating second-order temperature-related terms, making it hard to meet the high precision requirements of certain circuits. The existing circuit has a high-temperature coefficient issue that requires urgent compensation for higher-order terms. This paper proposes a novel high-order curvature compensation method, successfully implementing a low-temperature coefficient voltage reference circuit by leveraging the subthreshold characteristics of CMOS transistors. Initially, two currents with different temperature coefficients flow through the same subthreshold CMOS transistor, generating two gate-source voltages with unique temperature characteristics. Subsequently, the subtraction of these voltages produces a logarithmic voltage, and the logarithmic voltage is weighted and superimposed with the first-order compensation voltage to realize the high-order compensation. To enhance the power supply rejection ratio (PSRR), the circuit employs a high-gain negative feedback loop, eliminating the need for an amplifier in traditional voltage reference circuits and further reducing power consumption. This design is based on the 0.18 μm CMOS process and is implemented using Cadence software for circuit design, layout, and simulation verification. Simulation results indicate that the circuit operates within a normal voltage range of 1.6 V~3 V, with a reference voltage output of 295 mV at 2 V operating voltage. The temperature coefficient within the range of -45 ℃ to 125 ℃ is 1.26 ppm/℃, and the PSRR is 51.1 dB@1 kHz, with a maximum static current of 8.9 μA. These results show that the voltage reference circuit can meet the needs of high-precision integrated circuit systems.

Graphical abstract

关键词

低温度系数 / 亚阈值 / 电压基准 / 高阶曲率补偿

Key words

引用本文

引用格式 ▾
张涛, 邱云飞, 刘劲. 一种低温度系数高阶补偿基准电压电路设计[J]. 湖南大学学报(自然科学版), 2024, 51(6): 178-186 DOI:10.16339/j.cnki.hdxbzkb.2024237

登录浏览全文

4963

注册一个新账户 忘记密码

电压基准电路在集成电路中扮演着重要的角色,广泛应用于模拟和数模混合集成电路中,例如AD转换器,LDO、DC-DC转换器和传感器系统.基准电压的精度和性能直接影响这些电路的性能1-6.基准电压的指标包括低线性灵敏度、低噪声、低功耗、宽的温度范围内低温度系数(Temperature Coefficient, TC)、高电源抑制比(Power Supply Rejection Ratio, PSRR)以及小的面积.然而,同时实现所有的这些指标是非常困难的.因此,为了平衡实际应用和规范要求,这些指标参数的取值应该根据实际的应用进行权衡37.
与温度无关的基准电压在许多模拟电路中是必不可少的8,半导体中不能直接产生与环境温度无关的电压,因此,温度无关基准电压通常通过结合两种具有相反温度系数(TC)特性的电压进行叠加产生.1964年仙童半导体公司的Hibliber观察到两个二极管在不同的电流密度下的电压叠加可以产生与温度无关的电压9.随后,1965年Widlar明确地证明了在不同电流密度下,两个双极性晶体管(Bipolar Junction Transistor, BJT)的基极-发射极有一个与绝对温度成正比(Proportional To Absolute Temperature, PTAT)的电压差10.在传统的带隙基准设计中,BJT中的基极-发射极产生绝对温度成互补关系的(Complementary to Absolute Temperature, CTAT)电压(VBE)和PTAT电压相结合以获得一阶曲率补偿.然而,这种一阶曲率补偿的带隙基准电源温度系数在10~100 ppm/℃,如果要获得更低的温度系数就需要进行温度系数补偿.又因为获得的这种基准电压与硅的能带电压差不多,约为1.25 V,所以不能应用超低压电路,而且功耗较高.为了克服这些缺点,使用亚阈值区的MOSFET产生基准电压近年来被大量研究,但是这些基准电压的温度灵敏度高,工作温度范围小.随着现代系统中数据处理的精度的提高,通过一阶曲率补偿电压已不能满足这些需求.目前已经发展出BJT和亚阈值MOSFET相互补偿211,二次温度补偿612-13、指数温度补偿6,这些补偿都是温度有关的二阶项进行补偿,电路中仍然存在与温度相关的高阶项,获得的基准电压精度有限.而可调节分段补偿14-15、分段线性曲率修正、温度依赖电阻补偿等温度补偿方法,虽然可以实现低的温度系数,但在电路实现上过于复杂.近年来利用MOSFET在不同反型层对温度的敏感性不同进行补偿可以获得更高的效率和更低的温度系数41216-18].
本文提出一种利用MOSFET亚阈值特性产生基准电压的电路,利用流过相同阈值电压NMOS晶体管漏极电流的温度特性不同,来实现栅极电压温度特性差异,通过两种不同温度特性的电压相减产生对数电压与一阶补偿电压加权叠加进行高阶曲率补偿.全文的组织结构如下:第一段描述工作在亚阈值区MOSFET的工作原理;第二段介绍所提到的系统设计原理与实现;第三段呈现设计的仿真结果;最后一段为结论.

1 亚阈值区MOSFET的栅源电压工作原理

当MOSFET的栅源电压低于阈值电压(VTH)时,晶体管并不会完全截至,而是工作在亚阈值区.在亚阈值区的漏源电流(IDS7, 18-22可以写为:

IDS=μCoxWLη-1VT2expVGS-VTHηVT×       1-exp-VDSVT

式中:μ是迁移率因子,Cox为单位面积栅氧化层电容,VT是热电压,η是非理想因子是一个常数,VTH是MOSFET的阈值电压,VGS是栅源电压,VDS是MOSFET的漏源电压,W/L是晶体管的宽长比.在亚阈值区域,当VDS≥4VTIDS可以写成:

IDS=μCoxWLη-1VT2expVGS-VTHηVT

公式(2)可以得出栅源电压(VGS)为:

VGS=VTH+ηVTlnIDSμCoxW/Lη-1VT2

公式(3)可以看出工作在亚阈值区的MOS管的栅源电压几乎与VDS无关,只与VTHVTμ有关,这些都是与温度有关的参数,对于VTH的表达式可以写为:

VTHT=VTH0-kTT

式中:VTH0是在0 K温度下的阈值电压, kT是一个常数,T是绝对温度,因此VTH随着温度的增加而减少.

迁移率μ与温度的关系可以写为:

μ=μ0TT0-m

式中:μ0是参考温度T0下的迁移率,m是迁移率的温度指数,1m2.

VTT=kTq

式中:k是玻尔兹曼常数,T是绝对温度,q是电荷量.

通过式(3)~式(6),栅源电压(VGS)可以被写成为:

VGS=VTH0-kTT+       ηkTqlnIDSq2μ0T0mCoxW/Lη-1k2T2-m

对于m=2,栅源电压(VGS)对于温度的导数为:

VGST=-kT+kqlnIDSq2μ0T02CoxW/L(η-1)k2

因为IDSq2μ0T02CoxW/Lη-1k2 <1,所以栅源电压(VGS)对于温度的导数VGST是个负值.因此,VGS随温度升高而降低,具有CTAT特性.

2 本文所提出的基准电压电路

2.1 基准电路的思路

本文所提出的基准电路设计思路如图1所示,首先,利用MOSFET的亚阈值区生成两种电流,分别为IPTAT电流和ICTAT电流.通过这两种电流进行加权叠加到电阻上,实现了基准电压的一阶补偿;其次,将经过一阶补偿后的电流和IPTAT电流流过相同的晶体管,得到了两个具有不同温度特性的电压VGS.将这两个VGS电压相减,得到包含与温度成对数关系的电压;最后将这个电压与一阶补偿的基准电压进行加权叠加来获得高阶补偿.

2.2 IPTAT电流和ICTAT电流的产生

本文提到的与电源无关的IPTAT电流和ICTAT电流产生的电路如图2所示,电路由M1~M10和电阻R1、R2组成.其中M1~M4工作在亚阈值区,M5~M10工作在饱和区,M9使用了耗尽型晶体管,提高了电路的性能,使电路能在更低的电压下正常工作.IPTAT电流是通过晶体管M1~M3,M5~M7构成负反馈环路产生的,电路中包含两个环路,分别为环路Ⅰ和环路Ⅱ.在环路Ⅰ中,当电源电压升高导致X点电压升高时,Y点电压降低,Y点电压降低导致Q点电压升高,进而导致X点电压降低,环路I是负反馈环路.在环路Ⅱ中,当X点电压升高,Q点电压降低.随着Q点电压降低,X点电压升高,因此,环路Ⅱ是正反馈环路.由于负反馈的环路增益大于正反馈的.环路增益,整个环路可以保持稳定.通过设置M5和M6宽长比相等,确保流过M2和M1电流相等,从而保证Q点和Y点电压相等.此外,负反馈环路消除了运算放大器的使用,简化了结构并降低了功耗.

根据图2知M1和M2栅源电压VGS2VGS1的关系为:

VGS2=VGS1+I1R2

公式(3)可知栅源电压VGS2VGS1可以表示为:

VGS1=VTH+ηVTlnI1μCoxW/L1η-1VT2
VGS2=VTH+ηVTlnI1μCoxW/L2η-1VT2

由式(9)~式(11)可以得出电流I1表达式为:

I1=ηVTR1lnW/L1W/L2

式中:(W/L1和(W/L2分别表示晶体管M1和M2的宽长比.可以看出电流I1与热电压VT成正比,并且与电源电压无关.

类似的,另一个由晶体管M4、M9~M10和R2构成了负反馈环路用来产生ICTAT电流,当电源电压增加时,ICTAT电流也会增加,这导致S点的电压上升,而S点的电压升高又导致V点的电压下降,最终使S点的电压降低.因此,ICTAT电流得以减少.这种电压的变化可以使S点电压基本保持稳定.从图2可知电流I2可以表示为:

I2=VGS2R2

从式中:可以看出I2依赖于M4晶体管工作在亚阈值区的栅源电压.

可以得到IDS4I1的关系为:

IDS1=W/L8W/L6I1

式中:(W/L8和(W/L6是晶体管M8和M6的宽长比.

由式(6)~式(14)可以将I2表示为:

I2=1R2VTH0-kTT+kTqlnα1-1-mηkTqlnT

式中:α1=ηqW/L8ln W/L1W/L2R1μ0T0mCoxη-1kW/L4W/L6,可以看出电流I2与温度成非线性关系,其中非线性量是由1-mkTR2qln T引起的.

2.3 提到的高阶曲率补偿参考电压

可以观察到,直接利用IPTAT电流和ICTAT电流产生基准电压只能简单地补偿一阶项,而电压中仍存在与温度有关的高阶项.同时,如果流过工作在亚阈值区MOSFET的漏源电流的温度系数存在差异,可以产生温度特性不同的VGS.由于VGS的高阶项来源于对数项,只需生成对数分量,使其精确相等但符号相反,即可实现补偿.本文所提出电路如图3所示,图中分为4部分,第Ⅰ部分如前文所述,产生与电源电压无关的电流I1I2.第Ⅱ部分是产生两个温度特性不同的VGS,并通过电阻R3和R4转换为电流.同样的,为了确保电路能在低电压下正常工作,M13和M17使用耗尽型晶体管,而M14和M18工作在亚阈值区.第Ⅲ部分是一个减法电路,将第2部分产生温度特性不同的电流相减.第Ⅳ部分是输出电路,通过将不同温度系数的电流叠加到不同大小的电阻上,得到高阶补偿的电压VREF.

图3中,流过M14的电流I14是流过M11和M12的电流叠加,其中I11是通过M6和M11的镜像得到,与I1具有相同的温度系数.而I12是通过M10和M12的镜像得到,与I2有相同的温度系数.通过调整电阻R1和R2的阻值大小,可以得到没有一阶温度项的电流I14,流过M18的电流是通过M7镜像的倒数PTAT电流.由于M14和M18漏源电流的温度系数不同,产生了温度系数不同的VGS.通过电阻R3和R4产生温度系数不同的电流I15I19,并将其相减,与VGS4产生的高阶项因子叠加来进行补偿,从而得到VREF电压.

式(12)式(13)可以得到电流I14的表达式为:

I14=W/L11W/L6ηVTR1lnW/L1W/L2+W/L12W/L10VGS2R2

式中:(W/L11、(W/L6、(W/L12、(W/L10分别是晶体管M11、M6、M12、M10的宽长比.通过调节这些晶体管的宽长比和电阻R1、R2的阻值可以得到一阶温度系数的I14.那么I15可以表示为:

I15=1R3VTH14+ηkTqln α2-2-mηkTqlnT

式中的α2可以为:

α2=I14q2μ0T0mCoxη-1k2W/L14

式中:I14是经过一阶补偿后的电流,高阶温度系数项很小,在这可以忽略,α2可以看成一个与温度无关的常数.

同样地I18可以表示为:

I18=W/L16W/L6ηVTR1lnW/L1W/L2

可以看出I18是与绝对温度成正比的电流.那么I19可以表示为:

I19=1R4VTH18+ηkTqln α3-1-mηkTqlnT

α3可以表示为:

α3=ηqW/L16W/L6lnW/L1W/L2R1μ0T0mCoxη-1kW/L18

可以看出α3也是一个与温度无关的常数.

选择R3与R4阻值相等,M14和M18宽长比相同.将电流I15I19相减可以得到:

I15-I19=1R3ηkTqlnα2α3-ηkTqlnT

从而得到的电流很小,为了使晶体管M24工作在饱和区,可以同时将电流I15I19扩大N倍,可得到I24为:

I24=NR3ηkTqlnα2α3-ηkTqlnT

通过保证M24和M25相同,M26和M27相同可以得到:

I27=I24

I27I28I29进行加权叠加的补偿电压基准为:

VREF=W/L29W/L10I2R5+W/L28W/L6I1R5+R6+
         I27R5+R6+R7

根据式(12)式(15)式(23),将I1I2I27代入公式(25)得:

VREF=W/L29R5W/L10R2VTH4+ηkTqln α2-
         2-mηkTqlnT+
         W/L28R5+R6W/L6R1ηTqlnW/L1W/L2+
NR5+R6+R7R3ηkTqlnα2α3-ηkTqlnT

式(26)中,当W/L29R5W/L10R2m-1=NR5+R6+R7R3,可以完全消除与温度有关的对数项.公式(26)可以被表示为:

VREF=W/L29R5W/L10R2VTH0-kT+ηkTqln α2+
         m-1ηkTqlnα2α3+
        W/L28R5+R6W/L6R1ηTqlnW/L1W/L2

公式(27)关于温度T求导可得:

VREFT=-kTW/L29R5W/L10R2+W/L29R5W/L10R2×
             ηkqlnα1+m-1lnα2α3+
             W/L28R5+R6W/L6R1ηqlnW/L1W/L2

调整M29、M10、M28、M6的宽长比和电阻R2、R5、R6的阻值使得VREFT=0,可以得到所设计的基准电压为:

VREF=W/L29R5W/L10R2VTH0

通过公式(29)可知该过程消除了与温度相关的项,获得了与温度无关的基准电压VREF,实现了基准电压的高阶补偿.

3 仿真结果

设计了所提出的高阶曲率温度补偿电压基准,采用BSIM3V3 180 nm CMOS工艺,选用3.3 V的晶体管.晶体管宽长比参数和电阻阻值如表1所示.在Cadence virtuoso模拟设计环境中进行版图设计与仿真验证.总体版图如图4所示,总体版图面积为0.037 4 mm2.为减少版图设计对基准电压的影响,电阻阵列和MOS管采用插值结构,减少工艺变化引起的不匹配.

图5为在输入电压为2 V时输出电压VREF随着温度变化的曲线,从图中可以看出在室温(27 ℃)时输出电压为295.3 mV,并且在全温度范围下输出电压最大为295.36 mV.因此根据公式(30)可以得到该温度系数为1.26 ppm/℃.

TC=maxVREF-minVREFaverageVREFTmax-Tmin

在芯片制造中工艺误差不可避免地会影响电路的参数,主电路设计完成后,有必要考虑工艺偏差的影响.本文利用三种器件:MOSFET、耗尽型MOSFET和电阻完成设计/耗尽型MOSFET不参与电路主要参数的构建,影响电路性能的主要为MOSFET和电阻.由公式(26)可以看出如果电阻是同类型且匹配良好,那么电阻也不会影响电路的性能,影响电路性能的只有MOSFET.图6显示了在不同工艺角下(tt、ff、ss、fs、sf)基准电压VREF的输出波形.从图中可以看出不同极端情况下输出电压VREF随温度的变化规律.最好的情况为tt工艺角下,温度系数为1.26 ppm/℃,最坏的情况为ss工艺角,温度系数为85.08 ppm/℃.

图7是不同电源电压:1.6 V、2 V、2.5 V和3 V下输出VREF随温度(从-45 ℃变化到125 ℃)的变化曲线.在这些电压下,输出电压VREF的温度系数分别为4.38 ppm/℃、1.26 ppm/℃、9.81 ppm/℃和16.88 ppm/℃.

图8显示了电路在没有修调下1 000个蒙特卡洛的仿真结果,仿真包含了失配和工艺变化来对带隙电压进行预测,与工艺角仿真相比,蒙特卡洛仿真能更准确预测电路的真实情况.仿真结果显示输出基准电压的均值为295.787 mV,标准差σ值为4.92 mV.变化系数(μ/σ)为1.66%,表明对工艺和失配有较好的鲁棒性.

图9显示了PSRR在常温下(27 ℃)输入电压2 V输出电压为295 mV下与频率的变化关系,该PSRR曲线是没有使用任何滤波电容得到的.可以看出PSRR在频率100 Hz和10 kHz分别为-51.1 dB和-48.5 dB.而图10显示了在不同工艺角下的PSRR情况,由图可以看出不同工艺角下PSRR相差不大.其中最差工艺角为ff工艺角,在频率100 Hz和10 kHz下PSRR分别为-48.9 dB和-47.1 dB.最好工艺角为ss工艺角,在频率100 Hz和10 kHz下PSRR分别为-52.4 dB和-49.3 dB.

本文所设计的基准电压电路与同类型的基准电压电路的性能对比如表2所示,从表2可以看出本文设计的温度系数优于同类型的设计.虽然输出的基准电压受工艺影响方面不如BJT晶体管稳定,这是因为MOSFET的VTH受工艺影响较大.

4 结 论

本文在0.18 μm工艺下设计了一种低温度系数的基准电压源,并通过详细的公式论证了所提出方法的可行性.相较于传统基准电压电路,新的设计不仅实现了更低的温度系数,同时降低了输入电压范围和电路的功耗.仿真结果显示,在2 V输入的情况下,基准输出电压稳定在295.3 mV,且在-45 ℃到125 ℃温度范围内,温度系数为1.26 ppm/℃.在频率为100 Hz和10 kHz时,电路的PSRR分别达到了51.1 dB和48.5 dB.静态电流的最大值为8.9 μA.通过蒙特卡洛分析验证了电路的良好鲁棒性,表明了该电路能够满足高精度集成电路系统的需求.

参考文献

[1]

伍锡安,章泽臣,袁圣越, .一种快速建立的低噪声带隙基准源设计与实现[J].电子学报202149(11):2195-2201.

[2]

WU X AZHANG Z CYUAN S Yet al .Design and implementation of a fast set-up and low-noise bandgap reference[J].Acta Electronica Sinica202149(11):2195-2201.(in Chinese)

[3]

ZHOU Z KSHI YWANG Yet al .A resistorless high-precision compensated CMOS bandgap voltage reference[J].IEEE Transactions on Circuits and Systems I:Regular Papers201966(1):428-437.

[4]

QUE L CMIN D GWEI L Het al .A high PSRR bandgap voltage reference with piecewise compensation[J].Microelectronics Journal202095:104660.

[5]

MOHAMMED MABUGHARBIEH KKAWAR S .Design of a sub 1-V MOSFET based voltage reference circuit operating in subthreshold region[C]//2013 IEEE 20th International Conference on Electronics,Circuits,and Systems (ICECS).Abu Dhabi,United Arab Emirates. IEEE,2013:897-900.

[6]

AMIRI HJALALI M .A CMOS self-biased 6.8 ppm/ºC area-efficient subthreshold voltage reference[C]//2015 23rd Iranian Conference on Electrical Engineering.Tehran,Iran: IEEE,2015:1341-1345.

[7]

LUO H RSUN QZHANG R Zet al .A 1-V 3.1-ppm/℃ 0.8-μW bandgap reference with piecewise exponential curvature compensation[C]//2018 IEEE Asian Solid-State Circuits Conference (A-SSCC).Tainan,Taiwan,China: IEEE,2018:97-98.

[8]

THAKUR APANDEY RRAI S K .High-performance sub-1V CMOS voltage reference with low supply voltage[J]. AEU-International Journal of Electronics and Communications2022156:154392.

[9]

毕查德·拉扎维. 模拟CMOS集成电路设计[M]. 陈桂灿, 等译. 西安:西安交通大学出版社, 2018:459-477.

[10]

BEHZAD R. Design of analog CMOS integrated circuits[M]. Tanslated by CHEN G C, et al. Xi’an: Xi’an Jiaotong University Press,2018.(in Chinese)

[11]

HILBIBER D .A new semiconductor voltage standard[C]//1964 IEEE International Solid-State Circuits Conference.Digest of Technical Papers. Philadelphia,PA,USA. IEEE,1964:32-33.

[12]

WIDLAR R .Some circuit design techniques for linear integrated circuits[J].IEEE Transactions on Circuit Theory196512(4):586-590.

[13]

谢海情,王振宇,曾健平, .一种低温漂高电源电压抑制比带隙基准电压源设计[J].湖南大学学报(自然科学版)202148(8):119-124.

[14]

XIE H QWANG Z YZENG J Pet al .Design of bandgap voltage reference with low temperature drift and high PSRR[J].Journal of Hunan University (Natural Sciences)202148(8):119-124.(in Chinese)

[15]

GHANAVATI NEJAD TFARSHIDI ESJÖLAND Het al .A high precision logarithmic-curvature compensated all CMOS voltage reference[J].Analog Integrated Circuits and Signal Processing201999(2):383-392.

[16]

LIU X FYANG S WWANG J Fet al .A high-order curvature compensated voltage reference based on lateral BJT[J].AEU-International Journal of Electronics and Communications2020124:153325.

[17]

胡佳俊,陈后鹏,蔡道林, .高电源抑制比低温漂带隙基准源设计[J].微电子学201242(1):34-37.

[18]

HU J JCHEN H PCAI D Let al .Design of low temperature-drift bandgap voltage reference with high PSRR[J].Microelectronics201242(1):34-37.(in Chinese)

[19]

奚冬杰,徐晴昊 .高精度分段线性补偿基准电压源[J].电子技术应用202248(3):41-44.

[20]

XI D JXU Q H .High precision piecewise linear compensated voltage reference[J].Application of Electronic Technique202248(3):41-44.(in Chinese)

[21]

LUO HHAN YCHEUNG R C Cet al .Subthreshold CMOS voltage reference circuit with body bias compensation for process variation[J].IET Circuits,Devices & Systems,20126(3):198.

[22]

RAYAT HDASTANIAN R .A fully MOSFET voltage reference with low power consumption and high power supply rejection ratio for IoT microsystems[J].Jordan Journal of Electrical Engineering20228(2):102.

[23]

XIN XHU Y HCAI J Pet al .A 0.6 V,1.56 nW,5.87-ppm/℃,0.23%/V CMOS-only subthreshold voltage reference with the threshold voltage difference[J].Circuits,Systems,and Signal Processing,202241(8):4256-4274.

[24]

THAKUR APANDEY RRAI S K .Low temperature coefficient and low line sensitivity subthreshold curvature-compensated voltage reference[J].International Journal of Circuit Theory and Applications202048(11):1900-1921.

[25]

ZAWAWI R AKIM J KPARK J Bet al .A 3.3 V,8.89 μA and 5.5 ppm/℃ CMOS bandgap voltage reference for power telemetry in retinal prosthesis systems[J].Annual International Conference of the IEEE Engineering in Medicine and Biology Society.IEEE Engineering in Medicine and Biology Society.Annual International Conference20182018:2977-2980.

[26]

MOHAMMED MABUGHARBIEH KABDELFATTAH Met al .Design of a voltage reference circuit based on subthreshold and triode MOSFETs in 90 nm CMOS[C]//2014 IEEE International Conference on IC Design & Technology.Austin,TX,USA: IEEE,2014:1-4.

基金资助

国家自然科学基金资助项目(61873196)

AI Summary AI Mindmap
PDF (2423KB)

269

访问

0

被引

详细

导航
相关文章

AI思维导图

/